Creo que está en el camino correcto para estar pensando en FPGA, pero sospecho que los problemas de SI serían su ruina con el enfoque que está considerando, los trozos y / o el sondeo externo de trazas diferenciales de alta velocidad tienden a causar problemas.
¿Ha considerado la idea de desoldar el chip DDR3 por completo y crear un PCBA intermedio con el FPGA y el DDR3? Luego, podría intentar hacer algo como replicar el patrón de bola DDR3 en la parte inferior de la PCBA y luego volverlo a colocar en el lugar del chip en el sistema original. Las líneas DDR se enrutarían a la FPGA, con impedancias apropiadas y trazas coincidentes de longitud (muy corta). Entonces podría, con suficientes transceptores en el FPGA, crear una transferencia a través de la lógica dentro del FPGA al chip real en otra parte de su nueva placa, mientras al mismo tiempo indaga las transferencias de datos entre la memoria y el sistema subyacente dentro del FPGA.
¡Esto suena bastante desafiante en varios niveles, entre los que se incluye la cantidad de datos que puede almacenar y transmitir desde el FPGA para su análisis, incluso si todo funciona! Esa es una interfaz de muy alta velocidad.
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