Podría estar equivocado, pero esta es mi mejor suposición.
TL; DR: el diseño del controlador de memoria (en hardware) limita el espacio de direcciones. Solo hay 2 canales: DIMM máx. De 4 * 8 GB
El diseño del controlador de memoria en i3 es probablemente la razón principal:
Debido a las limitaciones de IO / factores de costo, los chips pueden tener solo 2 canales / 4 rangos (4 ranuras DIMM). Hay una gran cantidad de administración que se debe hacer en el chip para mantener las direcciones (programación de accesos, qué fila está abierta, qué fila debe actualizarse, etc.). Esto limita la capacidad de RAM por canal.
Aunque tiene un espacio de direcciones físicas de 39 bits, no tiene 39 pines físicos para transmitirlo desde el núcleo a la memoria. Tiene ~ 15 bits de dirección solamente + bus de datos: esto constituye 1 canal. Cada canal requiere más administración de memoria.
Tener más canales se volverá poco económico (i7, que es más caro, tiene 4 canales de memoria y, por lo tanto, admite 64 GB).
El i3 está nuevamente diseñado para manejar varios tipos diferentes de configuraciones de memoria: 1 gb, 2 gb, 4 gb, 8 b (por DIMM) en 1x, 2x, 3x (?), Configuración 4x (número de DIMM) (4 * 8 = 32 GB, que es el maximo)
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